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内容简介：本书由24章构成，全面、详细介绍了SystemVerilog语言。在概述SystemVerilog的概况和发展历史的基础上，分别介绍了用于设计和验证的构建块，数据类型，类，进程，赋值语句，运算符和表达式，执行语句，任务和函数，时钟块，进程同步和通信，检查器，程序，接口，包，模块，系统任务和系统函数，基于约束的随机激励生成，SystemVerilog的验证功能，硬件建模和验证，UVM，编译器预处理指令，仿真执行模型。